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verifica funzionale e debugging; • Integrazione FPGA con sistemi hardware e firmware; • Analisi timing, sintesi e validazione del design; • Collaborazione con team hardware e software; • Redazione della documentazione tecnica di progetto. Requisiti: • Laurea Triennale/Magistrale in Ingegneria Elettronica, Telecomunicazioni o affini ; • Esperienza nella progettazione FPGA con VHDL e/o Verilog; • Conoscenza del flusso di sviluppo FPGA (sintesi, place & route, timing analysis); • Familiarità con tool di sviluppo (Vivado, Quartus o equivalenti); • Buona conoscenza della lingua inglese; Se sei una persona che lavora bene in squadra e con atteggiamento orientato alla risoluzione dei problemi, unisciti ad AYES ed entra a far parte di un team appassionato e creativo che si impegna a offrire soluzioni di alta qualità ai nostri Clienti! Sei pronto a portare la tua carriera al livello successivo e a contribuire al successo di un'azienda leader nel settore della consulenza ingegneristica? Inviaci un tuo CV aggiornato! xrdztoy SAY YES AND GROW WITH AYES!

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