Junior Analog IC Layout Engineer – Transistor-Level Design (Milano)

Junior Analog IC Layout Engineer – Transistor-Level Design (Milano)

17 ago
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Move Silicon
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Milano

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Move Silicon

Milano

Chi siamo

Move Silicon è la business unit di Move S.p.A. dedicata allo sviluppo di soluzioni ASIC e SoC ad alta efficienza per applicazioni industriali, automotive e IoT. Lavoriamo in stretta collaborazione con clienti globali per portare sul mercato dispositivi analogici e mixed-signal innovativi, con un resistente focus sull’affidabilità e sulla sostenibilità dei nostri progetti.

La posizione

Cerchiamo un/una Junior Analog IC Layout Engineer che affianchi il nostro team di progettazione analogica nella realizzazione del layout transistor-level di circuiti ad alte prestazioni (amplificatori operazionali, LDO, ADC, reference, sensori). Il profilo ideale possiede solide basi di microelettronica, grande attenzione al dettaglio e forte motivazione a specializzarsi nel layout analogico professionale.

Responsabilità principali

Creazione del layout di blocchi analogici deep-submicron e BCD: amplificatori fully-differential, band-gap reference, regolatori di tensione, etc.
Applicazione di tecniche di matching avanzato (common-centroid, interdigitazione, simmetrie), guard-ring,



shielding e isolamento substrato.
Routing manuale di rete di alimentazione e segnali sensibili con minimizzazione di parassite R/C e couplage capacitivo.
Esecuzione e debug di DRC, LVS e PEX (Cadence Assura/PEX, Siemens Calibre) con focus su accuratezza di estrazione.
Collaborazione stretta con analog circuit designer per iterazioni di layout-versus-schematic e ottimizzazione area/performance.
Preparazione della documentazione di release (check-list, waiver, change-log) nel rispetto delle procedure di qualità interne.
Partecipazione a design review e programmi di formazione continua su metodologia e tool CAD.

Requisiti

Laurea triennale/magistrale in Ingegneria Elettronica o affini

Stage/tesi su layout analogico (≥ 6 mesi)

Conoscenza di Cadence Virtuoso e concetti PDK

Familiarità con nodi < 110 nm o processi BCD/HV

Comprensione di design-rule, DRC/LVS e basi di matching dispositivi

Script Skill

📌 Junior Analog IC Layout Engineer – Transistor-Level Design (Milano)
🏢 Move Silicon
📍 Milano

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