Flexible Fpga Design Engineer — Rtl/Verilog, Soc & Prototyping (Bardi)

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03 set
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Dedagroup
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Bardi

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Dedagroup

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Dedagroup cerca un professionista per la divisione FPGA che progetterà e verificherà algoritmi per l'elaborazione digitale, implementando protocolli di comunicazione e verifiche su simulazioni e misure.
La risorsa lavorerà su HDL (VHDL/Verilog/SystemVerilog), integrando IP di vendor e sviluppando soluzioni SoC, con attività di prototipazione, test e redazione di documentazione tecnica.
#J-*****-Ljbffr

📌 Flexible Fpga Design Engineer — Rtl/Verilog, Soc & Prototyping (Bardi)
🏢 Dedagroup
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