Senior Lab Validation Engineer - Rf/Analog & High-Speed Ics (Cava Manara)

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22 set
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ams Italy S.R.L.Si candidi tempestivamente! È previsto un elevato volume di candidati per il ruolo descritto di seguito, non aspetti a inviare il suo CV.is seeking a senior validation engineer to lead the bring-up and verification of RF, HF, analog, mixed-signal, and high-speed digital ICs in an onsite Lombardy setting.You will develop validation plans, characterize performance across PVT, and drive root-cause analysis for silicon issues. xysqume Collaboration with cross-functional teams and mentoring junior engineers are essential to ensure first-silicon success.#J-18808-Ljbffr

📌 Senior Lab Validation Engineer - Rf/Analog & High-Speed Ics (Cava Manara)
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