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Avezzano, Italy seeks a Design Engineer to drive RTL-to-GDSII physical implementation for advanced NAND flash digital blocks.
You will lead floorplanning, placement, clock tree synthesis, and routing with collaboration across RTL, DFT, analog, and verification teams. xlwpduy
Expect to optimize performance, power, and area while ensuring tape-out readiness.
You will leverage scripting to automate flows, enhance yield, and apply AI-assisted techniques to timing, congestion, and
📌 Senior Design Engineer (Roma)
🏢 Micron Technology
📍 Roma
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