Ricerca di un ingegnere per la modellazione e verifica di circuiti analogici e mixed-signal (AMS), con sviluppo di modelli in SystemVerilog RNM e verifica funzionale di IP complessi. Il ruolo richiede laurea in Ingegneria Elettronica e conoscenza di SystemVerilog UVM.
📌 Ams Verification (Volpiano)
🏢 AGAP2
📍 Volpiano
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